Astera Labs 豐富智能內存控制器產品線，新增 Leo X、Leo 2 E、Leo 2 P 系列
作者：溯波（實習） 責編：溯波 評論： 9 月 16 日消息，芯片高速互連初創企業 Astera Labs 美國加州當地時間 15 日宣佈以 Leo X、Leo 2 E、Leo 2 P 三系列豐富其 Leo 智能內存控制器產品線。Leo 2 E、Leo 2 P 是符合標準 CXL 3.2 規範的芯片，支持 4 個下游 DDR4 / DDR5 內存控制器。Leo 2 E 支持 PCIe Gen6 1×16 單端口配置；Leo 2 P 則在此基礎上允許 2×8 雙端口配置，實現附加內存的池化和共享。
與此同時，Leo X 系列是一款基於網絡架構的智能內存控制器，專為直接滿足 AI 加速器側的內存需求而設計。該系列芯片可與 Astera Labs 的 Scorpio 網絡交換芯片配套使用，通過 PCIe 和平臺專用協議實現 GPU 的橫向擴展，提供專用的內存層以卸載 KV Cache 和智能體上下文。Astera Labs 表示 Leo X 系列為 GPU 訪問 KV Cache 提供了更低延遲、更高帶寬的通道，能將首詞元延遲縮短多達 62%、詞元吞吐量提升多達 22%。
投訴水文 我要糾錯 下載APP，簽到賺金幣兌豪禮 相關文章關鍵詞：CXL，內存控制器，Astera Labs三星電子公佈 CXL 3.2 內存模組 MD310，256GB 容量基於 XL-FLASH，鎧俠將展示 CXL 存儲級內存擴展模塊瀾起業界率先試產 CXL 3.2 MXC（內存擴展控制器）芯片ScaleFlux 發佈 PCIe Gen6 NVMe SSD 控制器與 CXL 3.2 Type 3 內存控制器元腦服務器：推出 CXL 內存跨代擴展方案，實現 DDR5 和 DDR4 同機部署內存擴容消息稱三大 DRAM 原廠放棄第一方 CXL 內存控制器商業化
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